[訪談系列]
頻道上的第一個工程博士,所以加場放送😃
其實在看以璿ptt上的分享文時,就覺得他是一個很清楚自己要做什麼,要往什麼方向前進的人,所以會想跟他做這集,是想要讓他的“好”觀念來影響大家。我相信很多人其實在每個階段都會猶豫、迷茫一下,不過這個真的很正常,所以希望這個影片訪談可以讓更多想讀博士的人再去思考一下,自己到底適不適合。除了讀博士這件事情之外,最後他也會跟大家分享一下關於住在瑞士兩年的心得感想,一直以來我都覺得瑞士跟德國差不多,不過那是因為我比較常去的是德語區(蘇黎世)。聽完以璿分享後才知道,原來瑞士跟我想的不一樣呀~
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00:17 讀博士前應該要知道的事情
02:43 做研究應該有怎樣的心態,尤其實驗結果不好時?
05:47 會為了發表研究只講好的結果嗎?
07:38 瑞士實驗室跟台灣實驗室的差異?
09:49 目前有指導過碩士生的經驗嗎?
10:54 待了瑞士兩年後,對於瑞士的感想是?
[歐洲博士職缺搜尋平台]
https://www.researchgate.net/
https://www.nature.com/naturecareers
[歐洲常見的研究單位]
🇳🇱荷蘭:
https://www.tudelft.nl/en/about-tu-de...
https://www.tno.nl/en/about-tno/missi...
🇱🇺盧森堡:
https://wwwen.uni.lu/studies/doctoral...
🇧🇪比利時:
https://www.kuleuven.be/english/resea...
🇩🇪德國:
https://www.mpg.de/doctoral_students
https://www.fraunhofer.de/
https://www.helmholtz-berlin.de/index...
https://www.fz-juelich.de/portal/EN/H...
🇫🇷法國:
https://www.esrf.eu/
🇨🇭瑞士:
https://www.psi.ch/de
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▪︎ 德國大學排名:https://youtu.be/9XWqweyKowo
⇢德國留學訪談
▪︎ 高中申請學士(慕尼黑大學)https://youtu.be/rL3eG-X3NfQ
▪︎ 德國碩士獎學金(慕尼黑工大)https://youtu.be/HvS2e6WjZzo
▪︎ 瑞士博士申請(蘇黎世聯邦理工)https://youtu.be/nT0HYE1Ctn0
▪︎ 瑞士碩士申請(洛桑聯邦理工)https://youtu.be/ATmVnNDhHTE
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▪︎ 德國互惠生:https://youtu.be/x2Zysm7-0yk
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[瑞士訪談系列]
會認識以璿是因為看到他在ptt上面的分享,會特別有印象是因為他寫的真的很真誠,就在這次的瑞士之行前,想說來連絡看看好了~沒想到他很大方的答應了XD從訪問他的過程當中,更可以知道他對於研究的熱忱,還有清楚自己的方向與題目要選什麼,他在影片當中也分享到自己為什麼拒絕另一個職缺的原因,除此之外,他也會跟大家分享他申請的經驗,以及面試時的feeling,當教授說出哪句話就代表你拿到offer了!想知道更多就看下去吧!
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00:44 為什麼想讀博士?
01:12 覺得在台灣讀研究所後再出國有什麼幫助嗎?
03:12 當初為什麼想找歐洲的博士缺?
06:32 是用什麼網站去找博士缺的?
07:19 申請文件準備上有什麼困難的?
09:00 最後有面試到哪些學校或機構嗎?
11:46 有從這些面試中獲得什麼收穫嗎?
13:26 可以給那些想要申請博士的人建議嗎?
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de工程師ptt 在 [請益] 請問DV有機會跳DE嗎? PTT推薦- Tech_Job 的推薦與評價
大家好,小弟是新鮮人最近接到了一個竹科新安路附近外商DV的Offer,主要是寫SystemVeri log、UVM等等不過DV在IC廠的地位似乎不如DE 發展性不知道到底 ... ... <看更多>
de工程師ptt 在 [討論] DV完全是最棒的職位吧? 的推薦與評價
現在台灣逐漸開始重視DV DV地位竄升只要有IC就要有DV 不同於DD 做IP的很難隨便轉行你做CPU做到一半想去搞DRAM控制器幾乎要重新開始但是DV一招打天下想去做誰的驗證都 ... ... <看更多>
de工程師ptt 在 [心得] IC驗證工程師工作經驗分享- 看板Tech_Job - 批踢踢實業坊 的推薦與評價
在DV工作十年,算是一個里程碑?除了分享一些心得外,也再次推廣DV這個職務。 XD
感謝遇到的所有長官、同事、還有各種機緣。
先聲明,以下都是個人經驗分享,並非表示所有公司、部門狀況。
======= 從抄自己的文章開始 =======
以下 Digital Designer (簡稱DE)
指稱主要工作是用HDL(台灣多用Verilog)設計數位IC電路的工程師
Digital Verification Engineer(簡稱DV)
工作相關技能:
Part 1,
1. Linux + shell script
2. scipt language (Perl, Python, Tcl, ...)
3. simulator (IUS, VCS, ModelSim)
4. debugger (通常是Verdi)
5. SystemVerilog
5-1. 一般常用語法
5-2. SystemVerilog Assertion
5-3. Functional Coverage
6. UVM
7. FPGA
8. 各種Protocal(AMBA, SPI, I2C, SDIO, ...)
9. Domain know-how, know-why
10. GLS (gate-level simulation)
11. Static verifcation technologies. (formal verifcation)
12. AMS (analog/mixed signal) verifcation.
13. UPF (Unifed Power Format) low-power verifcation using UPF.
14. ARM CPU architechture
15. Embedded system (C/asm firmware)
16. Emulator (Zebu, HAPS, Palladium, Veloce)
17. SystemC modeling
Part 2,
1. 驗證團隊執行規劃
2. 帶新人
新增 5-2 SystemVerilog Assertion 獨立項目,是因為除了 dynamic simulation 之外,
還可以延伸到 formal verification。
新增 5-3 Functional Coverage 獨立項目,因為更加體會到其重要性。
Domain know-how, know-why 比較多且雜,就不列出細節項目了。
主要是透過再次分享工作累積的經驗,希望傳達給各位版友,
DV的技術深度及廣度是可以做得很高,不會落後於數位設計。
關於薪資、職涯出路發展、和數位設計職缺比較等問題,很多前人都有分享過了,
不在此贅述。(補充:我覺得做DE做DV「都很好」)
順便分享以前很難回答的問題:
關於UVM的學習書籍,市面上已經明顯比以前有更多選擇了,簡體、英文書都有。
以完全不花錢來說,我推薦可以註冊 SIEMEMS Verification Academy 網站,
有免費的 UVM cookbook pdf 可以下載,不過書籍排版做得不太好,比較建議看網頁版。
另外就是如果想要初步了解DV這個職務在做什麼事情,強力推薦一本書。
以下內容取自《ASIC/SoC Functional Design Verifcation》
+ SystemVerilog + UVM (Universal Verifcation Methodology).
+ UPF (Unifed Power Format) low-power verifcation using UPF.
+ AMS (analog/mixed signal) verifcation. Real number modeling, etc.
+ SystemVerilog Assertions (SVA) and functional coverage (SFC) languages
and methodology.
+ Coverage-driven verifcation(CDV) and constrained random verifcation(CRV).
+ Static verifcation technologies. Formal verifcation (model checking),
static + simulation hybrid methodology, X-state verifcation,
CDC (clock domain crossing), etc.
+ Logic equivalency check (LEC). Design teams mostly take on this task. But
the DV (design verifcation) team also needs to have this expertise.
+ ESL—Electronic System Level (TLM 2.0) virtual platform development (for
software development and verifcation tests/reference model development).
+ Hardware/software co-verifcation (hint: use virtual platform methodology).
+ SoC interconnect (bus-based and NoC—network-on-chip) verifcation.
+ Simulation speedup using HW acceleration, emulation, and prototyping.
最後分享,敝公司最近大舉招募,這應該不算是新聞了,
有興趣的版友可以趁最近去試試看,如果有DV相關的問題歡迎一起討論。
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※ 文章網址: https://www.ptt.cc/bbs/Tech_Job/M.1634410371.A.080.html
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