[新品報到] ADI公司推出臨床級四項生命體徵AFE-MAX86178可同步測量心電圖 (ECG)、心率、SpO2和呼吸率 適用於遠端病人監測設備
{編按:此品是maxim併入ADI後首款新品,勢將推助智慧醫療新進展!讓我們看下去..)
Analog Devices, Inc. (Nasdaq: ADI) 宣佈推出MAX86178三系統生命體徵類比前端(AFE),一片即可測量四項生命體徵信號,簡化可穿戴遠端病人監測(RPM)設備的設計。該單晶片AFE整合三種測量系統(光學、ECG和生物阻抗),可獲取四項常見生命體徵:心電圖 (ECG或EKG)、心率 (ECG或光學PPG)、血氧飽和度 (SpO2)和呼吸率(採用BioZ)。MAX86178支援光學PPG和ECG同步定時,幫助測量衍生健康指標。
醫療設備設計者希望用尺寸更小、功耗更低、方便在家中或辦公室持續穿戴的無線設備代替基於辦公室的健康監護系統,以降低每年與健康相關的支出。在單晶片IC中整合三種臨床級子系統,MAX86178 三系統AFE包括測量心率和SpO2的光學PPG子系統、單導聯ECG子系統以及測量呼吸率的生物電勢和生物阻抗(BioZ)子系統,以取代以往的分離式設計。器件將多種功能整合到2.6mm x 2.8mm的封裝內,進而支援小體積的生命體徵測量設備。
此外,下一代可穿戴PRM需要工作在較低功耗,以支援使用更小的電池或延長電池壽命,滿足更方便的充電要求。為了支援超低功耗特性,MAX86178為每個子系統提供可配置的選項,以優化具體應用場景下的電池壽命。
「將三種健康子系統整合到單晶片矽元件,ADI以其DNA為基礎推出了這款感測器融合產品。」Maxim Integrated®(現已併入Analog Devices)工業與醫療健康事業部執行業務經理Andrew Burt表示:「此款AFE為慢性病管理、傳染病診斷和遠端監測提供了新的可能,並引起醫學界的共鳴。MAX86178支援更小的體戴式設備,降低病患入院需求,進而提升醫療服務及降低成本。」
此外,ADI同時提供MAX20343升/降壓調節器,以及MAX20360電源管理IC作為MAX86178的電源優化方案。
MAX86178 三系統生命體徵AFE主要特性及優勢
• 小尺寸:與傳統分離式方案相比,方案尺寸縮小30%;利用體戴式設備代替醫療設施級監護系統。
• 簡化設計:作為業界首款整合和同步三種不同測量系統的單晶片IC,可測量四項生命體徵,簡化設計並支援更複雜的衍生生命體徵監測。
http://www.compotechasia.com/a/new_product/2021/0922/49075.html
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摩爾定律放緩 靠啥提升AI晶片運算力?
作者 : 黃燁鋒,EE Times China
2021-07-26
對於電子科技革命的即將終結的說法,一般認為即是指摩爾定律的終結——摩爾定律一旦無法延續,也就意味著資訊技術的整棟大樓建造都將出現停滯,那麼第三次科技革命也就正式結束了。這種聲音似乎是從十多年前就有的,但這波革命始終也沒有結束。AI技術本質上仍然是第三次科技革命的延續……
人工智慧(AI)的技術發展,被很多人形容為第四次科技革命。前三次科技革命,分別是蒸汽、電氣、資訊技術(電子科技)革命。彷彿這“第四次”有很多種說辭,比如有人說第四次科技革命是生物技術革命,還有人說是量子技術革命。但既然AI也是第四次科技革命之一的候選技術,而且作為資訊技術的組成部分,卻又獨立於資訊技術,即表示它有獨到之處。
電子科技革命的即將終結,一般認為即是指摩爾定律的終結——摩爾定律一旦無法延續,也就意味著資訊技術的整棟大樓建造都將出現停滯,那麼第三次科技革命也就正式結束了。這種聲音似乎是從十多年前就有,但這波革命始終也沒有結束。
AI技術本質上仍然是第三次科技革命的延續,它的發展也依託於幾十年來半導體科技的進步。這些年出現了不少專門的AI晶片——而且市場參與者相眾多。當某一個類別的技術發展到出現一種專門的處理器為之服務的程度,那麼這個領域自然就不可小覷,就像當年GPU出現專門為圖形運算服務一樣。
所以AI晶片被形容為CPU、GPU之後的第三大類電腦處理器。AI專用處理器的出現,很大程度上也是因為摩爾定律的發展進入緩慢期:電晶體的尺寸縮減速度,已經無法滿足需求,所以就必須有某種專用架構(DSA)出現,以快速提升晶片效率,也才有了專門的AI晶片。
另一方面,摩爾定律的延緩也成為AI晶片發展的桎梏。在摩爾定律和登納德縮放比例定律(Dennard Scaling)發展的前期,電晶體製程進步為晶片帶來了相當大的助益,那是「happy scaling down」的時代——CPU、GPU都是這個時代受益,不過Dennard Scaling早在45nm時期就失效了。
AI晶片作為第三大類處理器,在這波發展中沒有趕上happy scaling down的好時機。與此同時,AI應用對運算力的需求越來越貪婪。今年WAIC晶片論壇圓桌討論環節,燧原科技創始人暨CEO趙立東說:「現在訓練的GPT-3模型有1750億參數,接近人腦神經元數量,我以為這是最大的模型了,要千張Nvidia的GPU卡才能做。談到AI運算力需求、模型大小的問題,說最大模型超過萬億參數,又是10倍。」
英特爾(Intel)研究院副總裁、中國研究院院長宋繼強說:「前兩年用GPU訓練一個大規模的深度學習模型,其碳排放量相當於5台美式車整個生命週期產生的碳排量。」這也說明了AI運算力需求的貪婪,以及提供運算力的AI晶片不夠高效。
不過作為產業的底層驅動力,半導體製造技術仍源源不斷地為AI發展提供推力。本文將討論WAIC晶片論壇上聽到,針對這個問題的一些前瞻性解決方案——有些已經實現,有些則可能有待時代驗證。
XPU、摩爾定律和異質整合
「電腦產業中的貝爾定律,是說能效每提高1,000倍,就會衍生出一種新的運算形態。」中科院院士劉明在論壇上說,「若每瓦功耗只能支撐1KOPS的運算,當時的這種運算形態是超算;到了智慧型手機時代,能效就提高到每瓦1TOPS;未來的智慧終端我們要達到每瓦1POPS。 這對IC提出了非常高的要求,如果依然沿著CMOS這條路去走,當然可以,但會比較艱辛。」
針對性能和效率提升,除了尺寸微縮,半導體產業比較常見的思路是電晶體結構、晶片結構、材料等方面的最佳化,以及處理架構的革新。
(1)AI晶片本身其實就是對處理器架構的革新,從運算架構的層面來看,針對不同的應用方向造不同架構的處理器是常規,更專用的處理器能促成效率和性能的成倍增長,而不需要依賴於電晶體尺寸的微縮。比如GPU、神經網路處理器(NPU,即AI處理器),乃至更專用的ASIC出現,都是這類思路。
CPU、GPU、NPU、FPGA等不同類型的晶片各司其職,Intel這兩年一直在推行所謂的「XPU」策略就是用不同類型的處理器去做不同的事情,「整合起來各取所需,用組合拳會好過用一種武器去解決所有問題。」宋繼強說。Intel的晶片產品就涵蓋了幾個大類,Core CPU、Xe GPU,以及透過收購獲得的AI晶片Habana等。
另外針對不同類型的晶片,可能還有更具體的最佳化方案。如當代CPU普遍加入AVX512指令,本質上是特別針對深度學習做加強。「專用」的不一定是處理器,也可以是處理器內的某些特定單元,甚至固定功能單元,就好像GPU中加入專用的光線追蹤單元一樣,這是當代處理器普遍都在做的一件事。
(2)從電晶體、晶片結構層面來看,電晶體的尺寸現在仍然在縮減過程中,只不過縮減幅度相比過去變小了——而且為緩解電晶體性能的下降,需要有各種不同的技術來輔助尺寸變小。比如說在22nm節點之後,電晶體變為FinFET結構,在3nm之後,電晶體即將演變為Gate All Around FET結構。最終會演化為互補FET (CFET),其本質都是電晶體本身充分利用Z軸,來實現微縮性能的提升。
劉明認為,「除了基礎元件的變革,IC現在的發展還是比較多元化,包括新材料的引進、元件結構革新,也包括微影技術。長期賴以微縮的基本手段,現在也在發生巨大的變化,特別是未來3D的異質整合。這些多元技術的協同發展,都為晶片整體性能提升帶來了很好的增益。」
他並指出,「從電晶體級、到晶圓級,再到晶片堆疊、引線接合(lead bonding),精準度從毫米向奈米演進,互連密度大大提升。」從晶圓/裸晶的層面來看,則是眾所周知的朝more than moore’s law這樣的路線發展,比如把兩片裸晶疊起來。現在很熱門的chiplet技術就是比較典型的並不依賴於傳統電晶體尺寸微縮,來彈性擴展性能的方案。
台積電和Intel這兩年都在大推將不同類型的裸晶,異質整合的技術。2.5D封裝方案典型如台積電的CoWoS,Intel的EMIB,而在3D堆疊上,Intel的Core LakeField晶片就是用3D Foveros方案,將不同的裸晶疊在一起,甚至可以實現兩片運算裸晶的堆疊、互連。
之前的文章也提到過AMD剛發佈的3D V-Cache,將CPU的L3 cache裸晶疊在運算裸晶上方,將處理器的L3 cache大小增大至192MB,對儲存敏感延遲應用的性能提升。相比Intel,台積電這項技術的獨特之處在於裸晶間是以混合接合(hybrid bonding)的方式互連,而不是micro-bump,做到更小的打線間距,以及晶片之間數十倍通訊性能和效率提升。
這些方案也不直接依賴傳統的電晶體微縮方案。這裡實際上還有一個方面,即新材料的導入專家們沒有在論壇上多說,本文也略過不談。
1,000倍的性能提升
劉明談到,當電晶體微縮的空間沒有那麼大的時候,產業界傾向於採用新的策略來評價技術——「PPACt」——即Powe r(功耗)、Performance (性能)、Cost/Area-Time (成本/面積-時間)。t指的具體是time-to-market,理論上應該也屬於成本的一部分。
電晶體微縮方案失效以後,「多元化的技術變革,依然會讓IC性能得到進一步的提升。」劉明說,「根據預測,這些技術即使不再做尺寸微縮,也會讓IC的晶片性能做到500~1,000倍的提升,到2035年實現Zetta Flops的系統性能水準。且超算的發展還可以一如既往地前進;單裸晶儲存容量變得越來越大,IC依然會為產業發展提供基礎。」
500~1,000倍的預測來自DARPA,感覺有些過於樂觀。因為其中的不少技術存在比較大的邊際遞減效應,而且有更實際的工程問題待解決,比如運算裸晶疊層的散熱問題——即便業界對於這類工程問題的探討也始終在持續。
不過1,000倍的性能提升,的確說明摩爾定律的終結並不能代表第三次科技革命的終結,而且還有相當大的發展空間。尤其本文談的主要是AI晶片,而不是更具通用性的CPU。
矽光、記憶體內運算和神經型態運算
在非傳統發展路線上(以上內容都屬於半導體製造的常規思路),WAIC晶片論壇上宋繼強和劉明都提到了一些頗具代表性的技術方向(雖然這可能與他們自己的業務方向或研究方向有很大的關係)。這些技術可能尚未大規模推廣,或者仍在商業化的極早期。
(1)近記憶體運算和記憶體內運算:處理器性能和效率如今面臨的瓶頸,很大程度並不在單純的運算階段,而在資料傳輸和儲存方面——這也是共識。所以提升資料的傳輸和存取效率,可能是提升整體系統性能時,一個非常靠譜的思路。
這兩年市場上的處理器產品用「近記憶體運算」(near-memory computing)思路的,應該不在少數。所謂的近記憶體運算,就是讓儲存(如cache、memory)單元更靠近運算單元。CPU的多層cache結構(L1、L2、L3),以及電腦處理器cache、記憶體、硬碟這種多層儲存結構是常規。而「近記憶體運算」主要在於究竟有多「近」,cache記憶體有利於隱藏當代電腦架構中延遲和頻寬的局限性。
這兩年在近記憶體運算方面比較有代表性的,一是AMD——比如前文提到3D V-cache增大處理器的cache容量,還有其GPU不僅在裸晶內導入了Infinity Cache這種類似L3 cache的結構,也更早應用了HBM2記憶體方案。這些實踐都表明,儲存方面的革新的確能帶來性能的提升。
另外一個例子則是Graphcore的IPU處理器:IPU的特點之一是在裸晶內堆了相當多的cache資源,cache容量遠大於一般的GPU和AI晶片——也就避免了頻繁的訪問外部儲存資源的操作,極大提升頻寬、降低延遲和功耗。
近記憶體運算的本質仍然是馮紐曼架構(Von Neumann architecture)的延續。「在做處理的過程中,多層級的儲存結構,資料的搬運不僅僅在處理和儲存之間,還在不同的儲存層級之間。這樣頻繁的資料搬運帶來了頻寬延遲、功耗的問題。也就有了我們經常說的運算體系內的儲存牆的問題。」劉明說。
構建非馮(non-von Neumann)架構,把傳統的、以運算為中心的馮氏架構,變換一種新的運算範式。把部分運算力下推到儲存。這便是記憶體內運算(in-memory computing)的概念。
記憶體內運算的就現在看來還是比較新,也有稱其為「存算一體」。通常理解為在記憶體中嵌入演算法,儲存單元本身就有運算能力,理論上消除資料存取的延遲和功耗。記憶體內運算這個概念似乎這在資料爆炸時代格外醒目,畢竟可極大減少海量資料的移動操作。
其實記憶體內運算的概念都還沒有非常明確的定義。現階段它可能的內涵至少涉及到在儲記憶體內部,部分執行資料處理工作;主要應用於神經網路(因為非常契合神經網路的工作方式),以及這類晶片具體的工作方法上,可能更傾向於神經型態運算(neuromorphic computing)。
對於AI晶片而言,記憶體內運算的確是很好的思路。一般的GPU和AI晶片執行AI負載時,有比較頻繁的資料存取操作,這對性能和功耗都有影響。不過記憶體內運算的具體實施方案,在市場上也是五花八門,早期比較具有代表性的Mythic導入了一種矩陣乘的儲存架構,用40nm嵌入式NOR,在儲記憶體內部執行運算,不過替換掉了數位週邊電路,改用類比的方式。在陣列內部進行模擬運算。這家公司之前得到過美國國防部的資金支援。
劉明列舉了近記憶體運算和記憶體內運算兩種方案的例子。其中,近記憶體運算的這個方案應該和AMD的3D V-cache比較類似,把儲存裸晶和運算裸晶疊起來。
劉明指出,「這是我們最近的一個工作,採用hybrid bonding的技術,與矽通孔(TSV)做比較,hybrid bonding功耗是0.8pJ/bit,而TSV是4pJ/bit。延遲方面,hybrid bonding只有0.5ns,而TSV方案是3ns。」台積電在3D堆疊方面的領先優勢其實也體現在hybrid bonding混合鍵合上,前文也提到了它具備更高的互連密度和效率。
另外這套方案還將DRAM刷新頻率提高了一倍,從64ms提高至128ms,以降低功耗。「應對刷新率變慢出現拖尾bit,我們引入RRAM TCAM索引這些tail bits」劉明說。
記憶體內運算方面,「傳統運算是用布林邏輯,一個4位元的乘法需要用到幾百個電晶體,這個過程中需要進行資料來回的移動。記憶體內運算是利用單一元件的歐姆定律來完成一次乘法,然後利用基爾霍夫定律完成列的累加。」劉明表示,「這對於今天深度學習的矩陣乘非常有利。它是原位的運算和儲存,沒有資料搬運。」這是記憶體內運算的常規思路。
「無論是基於SRAM,還是基於新型記憶體,相比近記憶體運算都有明顯優勢,」劉明認為。下圖是記憶體內運算和近記憶體運算,精準度、能效等方面的對比,記憶體內運算架構對於低精準度運算有價值。
下圖則總結了業內主要的一些記憶體內運算研究,在精確度和能效方面的對應關係。劉明表示,「需要高精確度、高運算力的情況下,近記憶體運算目前還是有優勢。不過記憶體內運算是更新的技術,這幾年的進步也非常快。」
去年阿里達摩院發佈2020年十大科技趨勢中,有一個就是存算一體突破AI算力瓶頸。不過記憶體內運算面臨的商用挑戰也一點都不小。記憶體內運算的通常思路都是類比電路的運算方式,這對記憶體、運算單元設計都需要做工程上的考量。與此同時這樣的晶片究竟由誰來造也是個問題:是記憶體廠商,還是數文書處理器廠商?(三星推過記憶體內運算晶片,三星、Intel垂直整合型企業似乎很適合做記憶體內運算…)
(2)神經型態運算:神經型態運算和記憶體內運算一樣,也是新興技術的熱門話題,這項技術有時也叫作compute in memory,可以認為它是記憶體內運算的某種發展方向。神經型態和一般神經網路AI晶片的差異是,這種結構更偏「類人腦」。
進行神經型態研究的企業現在也逐漸變得多起來,劉明也提到了AI晶片「最終的理想是在結構層次模仿腦,元件層次逼近腦,功能層次超越人腦」的「類腦運算」。Intel是比較早關注神經型態運算研究的企業之一。
傳說中的Intel Loihi就是比較典型存算一體的架構,「這片裸晶裡面包含128個小核心,每個核心用於模擬1,024個神經元的運算結構。」宋繼強說,「這樣一塊晶片大概可以類比13萬個神經元。我們做到的是把768個晶片再連起來,構成接近1億神經元的系統,讓學術界的夥伴去試用。」
「它和深度學習加速器相比,沒有任何浮點運算——就像人腦裡面沒有乘加器。所以其學習和訓練方法是採用一種名為spike neutral network的路線,功耗很低,也可以訓練出做視覺辨識、語言辨識和其他種類的模型。」宋繼強認為,不採用同步時脈,「刺激的時候就是一個非同步電動勢,只有工作部分耗電,功耗是現在深度學習加速晶片的千分之一。」
「而且未來我們可以對不同區域做劃分,比如這兒是視覺區、那兒是語言區、那兒是觸覺區,同時進行多模態訓練,互相之間產生關聯。這是現在的深度學習模型無法比擬的。」宋繼強說。這種神經型態運算晶片,似乎也是Intel在XPU方向上探索不同架構運算的方向之一。
(2)微型化矽光:這個技術方向可能在層級上更偏高了一些,不再晶片架構層級,不過仍然值得一提。去年Intel在Labs Day上特別談到了自己在矽光(Silicon Photonics)的一些技術進展。其實矽光技術在連接資料中心的交換機方面,已有應用了,發出資料時,連接埠處會有個收發器把電訊號轉為光訊號,透過光纖來傳輸資料,另一端光訊號再轉為電訊號。不過傳統的光收發器成本都比較高,內部元件數量大,尺寸也就比較大。
Intel在整合化的矽光(IIIV族monolithic的光學整合化方案)方面應該是商業化走在比較前列的,就是把光和電子相關的組成部分高度整合到晶片上,用IC製造技術。未來的光通訊不只是資料中心機架到機架之間,也可以下沉到板級——就跟現在傳統的電I/O一樣。電互連的主要問題是功耗太大,也就是所謂的I/O功耗牆,這是這類微型化矽光元件存在的重要價值。
這其中存在的技術挑戰還是比較多,如做資料的光訊號調變的調變器調變器,據說Intel的技術使其實現了1,000倍的縮小;還有在接收端需要有個探測器(detector)轉換光訊號,用所謂的全矽微環(micro-ring)結構,實現矽對光的檢測能力;波分複用技術實現頻寬倍增,以及把矽光和CMOS晶片做整合等。
Intel認為,把矽光模組與運算資源整合,就能打破必須帶更多I/O接腳做更大尺寸處理器的這種趨勢。矽光能夠實現的是更低的功耗、更大的頻寬、更小的接腳數量和尺寸。在跨處理器、跨伺服器節點之間的資料互動上,這類技術還是頗具前景,Intel此前說目標是實現每根光纖1Tbps的速率,並且能效在1pJ/bit,最遠距離1km,這在非本地傳輸上是很理想的數字。
還有軟體…
除了AI晶片本身,從整個生態的角度,包括AI感知到運算的整個鏈條上的其他組成部分,都有促成性能和效率提升的餘地。比如這兩年Nvidia從軟體層面,針對AI運算的中間層、庫做了大量最佳化。相同的底層硬體,透過軟體最佳化就能實現幾倍的性能提升。
宋繼強說,「我們發現軟體最佳化與否,在同一個硬體上可以達到百倍的性能差距。」這其中的餘量還是比較大。
在AI開發生態上,雖然Nvidia是最具發言權的;但從戰略角度來看,像Intel這種研發CPU、GPU、FPGA、ASIC,甚至還有神經型態運算處理器的企業而言,不同處理器統一開發生態可能更具前瞻性。Intel有個稱oneAPI的軟體平台,用一套API實現不同硬體性能埠的對接。這類策略對廠商的軟體框架構建能力是非常大的考驗——也極大程度關乎底層晶片的執行效率。
在摩爾定律放緩、電晶體尺寸微縮變慢甚至不縮小的前提下,處理器架構革新、異質整合與2.5D/3D封裝技術依然可以達成1,000倍的性能提升;而一些新的技術方向,包括近記憶體運算、記憶體內運算和微型矽光,能夠在資料訪存、傳輸方面產生新的價值;神經型態運算這種類腦運算方式,是實現AI運算的目標;軟體層面的最佳化,也能夠帶動AI性能的成倍增長。所以即便摩爾定律嚴重放緩,AI晶片的性能、效率提升在上面提到的這麼多方案加持下,終將在未來很長一段時間內持續飛越。這第三(四)次科技革命恐怕還很難停歇。
資料來源:https://www.eettaiwan.com/20210726nt61-ai-computing/?fbclid=IwAR3BaorLm9rL2s1ff6cNkL6Z7dK8Q96XulQPzuMQ_Yky9H_EmLsBpjBOsWg
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5G將加速市場大爆發 韋僑科技搶攻RFID商機
廖家宜 2021-01-26
物聯網(IoT)時代,感測器成為不可或缺的前端數據採集源頭之一,讓各式各樣的裝置具有感知能力,推動人類正式進入智慧生活時代。而看好在5G技術加值下,感測應用商機將再度迎來大爆發,作為感測技術之一的無線射頻辨識(RFID),也可望因此帶來無限商機。
5G、智慧型手機加速RFID普及
RFID(Radio Frequency Identification),即所謂射頻識別技術,又稱電子標籤,由讀取器(Reader)和RFID標籤(Tag)組成。作為物聯網感知層的最核心技術,RFID已為物聯網時代帶來革命性改變。RFID具非接觸、遠距離、掃描速度快等特性,可同時對多標籤或高速運動下的物體進行辨識,除了現代人日常慣用的悠遊卡或eTag,近年像是零售、交通管理及物流倉儲等則是近年RFID最主要應用,而在COVID-19(新冠肺炎)驅使下,也刺激RFID在醫療領域的蓬勃發展,例如,透過RFID來追蹤疫苗流向。
而受惠智慧型手機的普及與5G高速發展,更加催化未來RFID商機的大爆發。由恩智浦半導體(NXP,前身為飛利浦半導體)、諾基亞(Nokia)和Sony共同研發的NFC,是以RFID為基礎的一種近場通訊技術,雖然NFC 2004年就出道,但作為行動裝置作業系統(OS)兩大陣營之一的iOS此前僅用以支持自家Apple Pay用,一直到2019年才正式開放權限供第三方使用,未來將開放不同類型NFC標籤可透過原生指令加以讀寫的功能,此舉將讓NFC應用更為廣泛且有彈性。
RFID大廠韋僑科技總經理江鴻佑觀察,未來智慧型手機將成為RFID應用相當重要的讀取器,當人手一機,「可以做的事就更多了!」。例如消費者在購買奢侈品時可以用手機為介面追蹤溯源,韋僑也正跟鹿谷農會進一步合作,要運用RFID技術驗證市場上販售的冠軍烏龍茶真偽。
江鴻佑相當看好NFC將帶來更彈性的三大應用,除了早已成熟普及的電子支付外,第二種則是以手機作為感應介面,進行不限任何裝置的配對,像日本就開發出能夠透過手機與多功能事務機直接配對連線,更方便的資料點對點傳輸,而第三種則是降低使用門檻的防偽溯源應用。
5G正式進入商用化,也成為加速RFID爆發的一股推動力。江鴻佑指出,5G的頻寬更大、速度更快,這對物聯網時代扮演關鍵角色的感測器來說無疑是開啟了更寬廣的大門,讓資料傳輸速度大幅提升,也因此能讓更多各式各樣的感測裝置在高速、低延遲且大連結的傳輸環境發揮更大作用,藉此拓展更多創新應用,如此一來,感測器的價值將會大大提升,而作為感測裝置之一的RFID,也因此受惠。
RFID市場百家爭鳴 一貫化生產能力佔先機
RFID研調機構IDTechEx預估,RFID市場規模將從2018年的116億美元,成長至2022年的130億美元。IDTechEx指出,RFID在許多領域加速發展,特別是零售業、服飾業更在過去3年受到許多關注。而RFID市場蓬勃,也帶動相關RFID製造商前景看好。
成立於1999年的韋僑科技,是台灣RFID研發製造專業大廠,是少數具有RFID從開發設計、製造及銷售等一條龍生產能力的供應商。9成產品外銷歐美及日本,包括知名醫藥大廠羅氏(Roche)、默克(Merck)、科技大廠Sony、零售業者安佳、樂高等都是其客戶。早期RFID被大量應用在交通電子票證,韋僑就曾在2004年拿到台北悠遊卡訂單,發行的600萬張悠遊卡就出自韋僑之手。
面對百家爭鳴的電子標籤市場,韋僑掌握包括天線設計、IC封裝、天線蝕刻及電子貼標貼合等自製能力,透過精密設計與製程的競爭優勢,聚焦量身定作的客製化產品。像是因應零售業者在服飾應用上對於軟性標籤的需求,韋僑投入鋁材質的電子貼標(Label)產品開發,除了在使用上更加符合需求,還因此成功將成本降為銅材質的10分之1,另外像是容易受金屬環境干擾的工業應用,韋僑也透過天線與材料的特殊處理,設計出能抗干擾的特殊性的RFID標籤。
RFID的產品應用領域可分為卡片、感應扣、Tag和電子貼標,特別是Tag和貼標這兩大應用能夠更加凸顯製造商少量多樣的設計製造能力,包括在天線設計、材料與製程上,都相當依賴製造商對於RFID技術應用之深度與廣度的掌握,才能夠配合客戶需求,提供品質及價格兼具的解決方案,這也是為何目前韋僑以RFID Label與RFID Tag為主力產品的原因之一。
其中智慧醫療就是韋僑在RFID Label深耕市場之一。像是RFID運用在醫療耗材產品,包括注射針筒及手術止血帶,醫師開刀後,可藉由讀取RFID適時盤點開刀房止血帶數量,避免發生人為疏忽。江鴻佑指出,雖然醫療領域開發週期長,但具有訂單穩定的優勢,且因產品皆經過美國FDA認證,客戶不易更 換供應商,是一高門檻,但高單價、高毛利的利基型市場。
客製化經驗 助台灣製造業加速邁向工業4.0
RFID在工業領域的應用則具有相當大的挑戰,但這也成為接下來韋僑在台布局目標之一。江鴻佑指出,大部分工業場景的干擾多,包括高溫、高濕,或佈滿金屬與酸鹼環境,RFID要能在工廠順利運行,光是在技術上就是一項挑戰,一旦前端感測層佈建受阻,將不利接下來各種智慧製造應用的推動。
江鴻佑也觀察到,由於RFID在工業應用上需要視每一種特殊情況因應,無論對SI業者或RFID製造商來說,需要能夠針對業者需求,設計並整合出符合場域的完整產品方案,「RFID技術很成熟,但是要找到合適的RFID方案就不是那麼容易了。」而江鴻佑認為,這是推動智慧製造最複雜且最難的部分,但往往也是目前台灣市場上最欠缺的。
因此這也成為韋僑接下來在台灣市場布局的主要目標之一。韋僑希望藉由過去為歐美日市場客戶客製化經驗,透過深耕不同垂直產業的系統整合商合作,成為台灣製造業者在物聯網解決方案的最佳夥伴。像是目前韋僑已初步跟中冠資訊合作,發展紡織業或無塵衣的RFID應用。
而像是近年在智慧機械常見的智慧刀具管理應用,也利用導入RFID作為刀具的產品履歷,即時掌握刀具的流向與維修狀態等。江鴻佑透露,過去國外大廠曾導入韋僑的RFID技術發展出智慧刀具應用,但包裝完賣給台灣製造業者卻有10倍價差。江鴻佑認為相當可惜,他認為,台灣製造業者具有發展智慧製造相當好的利基,只是缺少機會,沒找到對的Partner,而韋僑接下來布局台灣市場,就是希望能夠提供在地化且適合台灣製造業的最佳解決方案。
附圖:韋僑科技總經理江鴻佑。廖家宜攝
資料來源:https://www.digitimes.com.tw/iot/article.asp?cat=158&cat1=20&cat2=10&id=0000603270_9rt328cv6mn5ht1xtb5ur
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