#採訪筆記 #科技觀察
【宅經濟讓封裝產業一片樂觀,異質整合是未來關鍵趨勢】
最近不只台積電很紅,其實宅經濟掀起的一波商機,對於整個半導體產業來說,都樂翻了。不知道大家有沒有注意到10月初的一則工商時報新聞:「封裝廠產能爆滿,漲價超過10%」👏
不只日月光投控、菱生、超豐等封裝廠8月以來的打線封裝(wire bonding)訂單滿手,甚至年底前產能已全線滿載,且新聞還指出,封裝廠上游客戶為了搶產能,願意加價,讓第四季封裝價格漲了超過10%。
🔥這真是很奇特的半導體超火熱旺季。
上週廣播節目創意領航家邀請到台灣國際微電子暨構裝學會 iMAPS Taiwan 第五屆理事長、IMPACT-EMAP 2020主席 #蔡明義,來聊這個火熱議題,到底封裝產業現在真的夯爆嗎?
蔡主席很樂觀地說,確實因為疫情影響,居家工作與遠端學習需求增加,帶動無接觸經濟盛行,拉抬半導體業與資通訊產業旺季,而封裝產業屬於半導體產業後端,
半導體產業盛行,也使封裝產業訂單增加,另外印刷電路板業為電路系統平台,尤其在資通訊產業內扮演重要角色,因此印刷電路板業業績明顯成長。
看樣子真的很熱啊。這波5G、AI帶動的需求,以及宅經濟推升的半導體熱潮,還會延燒一陣子。
而節目中我們還聊到一個最近半導體產業非常熱門的話題:#異質整合,到底為何會如此火紅?
蔡主席分析,異質整合其實就算是高階封裝技術,概念是將不同的晶片整合在一個平台上或構裝材料上,這個集合可以提供更強的功能,也可以改善運作的品質。
而興起的原因是5G高速通訊與AI時代來臨,爆發各種新興科技應用,當晶片的效能、耗能、成本或是尺寸無法達到預期成效,
具備高度晶片整合能力的異質整合的晶片封裝技術興起,來彌補摩爾定律往下發展的挑戰與問題。
簡單來說,就是當摩爾定律發展到瓶頸時,晶片已經無法再越做越小,異質整合技術剛好是救星,透過將不同功能晶片整合在一起,可以達到體積不變、功能卻變大的效果,成為半導體產業突破摩爾定律的關鍵。
😆😆有趣的是,現在技術最純熟的,應該屬台積電了,也讓封裝市場版圖悄悄變動,台積電從晶圓代工加上高階封裝通通自己做,未來會變成什麼模樣呢?
Let’s see~!
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#朱楚文
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【劃時代變革:No Engineers,也能設計電子產品!】
「IC 60」,成了 2018 年半導體業界最響亮的流行語。今年是 IC 問世一甲子的輝煌銘刻,立足這個別具意義的特殊時間點,IC 產業高峰都預見了什麼樣的遠景?工業 4.0 已對半導體業產生質變——迫使 IC 公司投入電子、機械、感測器、射頻 (RF)、軟體與雲端的融合工作,儼然是另類系統供應商,與傳統系統廠的分界日漸模糊;而在眾多智能創新中,因熱能及電磁 (EM) 影響日增,印刷電路板 (PCB) 的優先順位也越來越高。
另眾所周知,汽車電子的終極目標是 0ppm 缺陷率;細究失效原因,有 80~95% 是由類比或混合訊號導致,而多數功率器件的出包是肇因於熱應力造成的焊錫和打線疲勞 (Fatigue)。再者,若電路板溫度和製程發生變異,也會加速電晶體老化、減少元件可用壽命,PCB 設計的重要性可見一斑。5G 系統更是如此!新的 NR 波形調變、與 4G 共模、大頻寬 RF 收發……,以及是否必須/允許增加散熱片 (heatsinks) 或孔洞 (drilling)?在在都是挑戰。
有鑑於新世代創意設計師,可能未必熟悉 Verilog 等硬體描述語言,電子設計自動化 (EDA) 廠商致力於推動「電子資訊化」,不用先編譯成近似組合語言的暫存器傳遞 (RTL) 就能轉化成機器碼,將能加速創意的實現。此舉有助於不擅長硬體或 RTL 設計的資訊工程 (IT) 專才評估測試方案,可為測試條件設限以達驗證收斂,並預防因經驗不足而漏失要項;對電子工程 (EE) 專才而言,一旦數據量的排列組合非常多,亦可借用模型驗證省下編寫測試案例的時間。
智能設計的終極目標是:「即使不具電子工程專業,也能設計晶片和電子產品!沒有做不到,只有想不到!」此外,與雲端業者的合作亦可圈可點,因為用戶不必一開始就耗費巨資投注在基礎設施,更有利於新創公司發展。時至今日,難度不在於晶片設計,而是應用商機,故更重視領域、應用及整個系統觀,從對的管道收集資料、做好分析,然後從中獲利。做出通用晶片再漫無目標地銷售已成過去式,開發者必須了解應用場景並據以發展專用晶片 (ASIC) 是較實際的作法。
延伸閱讀:
《全球瘋 AI 與 5G,ASIC 接棒擔綱——Cadence 樂當「電子設計」推進器》
http://compotechasia.com/a/opportunity/2018/0904/39800.html
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